Лекция 12 Структурная схема микроконтроллера
Среди многообразия существующих архитектур МК применяемых в настоящее время сложно определить необходимые конфигурации при выборе конкретного микроконтроллера. Попробуем систематизировать данные, имеющиеся в литературе, и рассмотрим назначение дополнительных блоков входящих в микроконтроллер и их вклад в его работу. Отличие МК от МП Выбор микроконтроллера Современный микроконтроллер состоит из Центрального процессора (ядра) (процессор, два и более умножителя, 6 и более АЛУ) Периферийных устройств памяти (память программ, память данных, память под порты ввода вывода, глобальная память) Выполнение операций над данными как с фиксированной, так и с плавающей точкой повлекло за собой усложнение структуры функциональных устройств. Это в свою очередь отразилось на сложности МП. Код программ выполняется на независимых функциональных устройствах в той же последовательности, в которой программируется. За счет применения инструкций сокращаются размеры кода и время выборки команд. Все инструкции содержат условия их выполнения, что снижает время на выполнение переходов по шине данных 256 разрядной можно передать восемь 32 разрядных команд. Для приложений требующих высокую степень точности применяют работу с 40 разрядными операндами. Повышенная точность достигается благодаря уменьшению ошибки округления результата в вычислительных модулях. Аккумулятор для 32 разрядных данных с фиксированной точкой имеет 80 разрядов. Для повышения быстродействия применяются сигнальные микропроцессоры. Производительность процессоров на сигнальных алгоритмах достигается благодаря многофункциональной и гибкой системе команд, аппаратной реализации большинства типичных для приложений операций, высокой степени параллелизма процессов в МП, сокращению командного такта, применением модифицированной гарвардской архитектуры.
Рис Блок схема МК 8535
Архитектура микроконтроллера ATmega8535 включает в себя · 130 команд процессора (большинство команд – однотактные); · 32 8-разрядных регистра общего назначения; · максимальная производительность 16 Mips (миллионов операций в секунду) (максимальная тактовая частота 16 МГц); · встроенный 2-тактный перемножитель; · 8 кбайт встроенной электрически перепрограммируемой FLASH памяти (с возможностью самопрограммирования), число циклов стирания-записи памяти не менее 10000; · 512 байт энергонезависимой памяти EEPROM; · 512 байт внутреннего ОЗУ (SRAM); · возможность защиты от чтения и модификации памяти программ и данных; · возможность программирования непосредственно в системе через последовательный интерфейс SPI. Периферия: · 2 8-разрядных независимых таймера-счетчика; · 1 16-битный таймер-счетчик; · счетчик реального времени с отдельным тактовым генератором; · 4 канала ШИМ; · 8 каналов 10-битного АЦП; · 2-проводный последовательный интерфейс; · интерфейс USART; · последовательный интерфейс SPI; · встроенный сторожевой таймер; · встроенный аналоговый компаратор; · 4 порта ввода-вывода, включающих 32 линии; Технические характеристики: · 40(44)- выводный корпус; · напряжение питания 4,5…5,5 В; · тактовая частота 0…16 МГц. Архитектура ядра микроконтроллера ATmega8535 Ядро микроконтроллеров AVR семейства Mega выполнено по усовершенствованной RISC-архитектуре (enhanced RISC) (рис. 4), в которой используется ряд решений, направленных на повышение быстродействия микроконтроллеров. Арифметико-логическое устройство (АЛУ), выполняющее все вычисления, подключено непосредственно к 32 рабочим регистрам, объединенным в регистровый файл. Благодаря этому, АЛУ может выполнять одну операцию (чтение содержимого регистров, выполнение операции и запись результата обратно в регистровый файл) за такт. Кроме того, практически каждая из команд(за исключением команд, у которых одним из операндов является 16-битный адрес), занимает одну ячейку памяти программ. Арифметико-логическое устройство (АЛУ) поддерживает арифметические и логические операции с операндами в виде двух регистров, либо регистра и константы. Большинство команд процессора выполняются за 1 такт, равный 1 периоду изменения тактового сигнала. Указатель исполняемой команды хранится в программном счетчике и автоматически изменяет свое значение при переходе на следующую команду. Команды процессора выполняются последовательно, в порядке их следования в программе. При выполнении команд передачи управления (условный или безусловный переход, вызов подпрограммы, прерывание) счетчик команд автоматически изменяет свое значение, указывая на новый адрес исполняемой команды. Во время прерывания или вызова подпрограммы адрес возврата в вызывающую (основную) программу сохраняется в стеке. Размер стека ограничен размером оперативной памяти. Рис расположение выводов микросхемы.
Flash память позволяет отказаться от металлокерамических корпусов с кварцевым стеклом необходимых для памяти с ультрафиолетовым стиранием это привело к резкому снижению стоимости МК с перезаписываемой памятью. Программируемый генератор тактов ожидания обеспечивает работу с медленной памятью. За счет увеличения числа тактов внешней шины при работе с медленным устройством. Параллельное функционирование генераторов сокращает длительность выполнения команды, позволяя за один такт выбирать из памяти команду и два операнда. В МП применяются генератор адресов команд (PS) , два генератора данных(DAG) . Наличие двух генераторов адреса обеспечивает пред и постформирование прямого и косвенного адреса данных, что позволяют выполнять над адресами модульные и бит реверсивные операции. Адресные генераторы обеспечивают аппаратную реализацию циклических буферов, позволяющих эффективно работать с АЦП, выполняя фильтрацию и преобразование Фурье Таймер счетчик обеспечивает периодическую генерации прерываний. Арбитр памяти обеспечивает совместное использование единой области памяти. Путем выработки сигналов запроса и сигналов готовности при обращении к глобальной памяти (память в МК делится на память программ, память данных память под порты ввода вывода, глобальная память) Параллельное логическое устройство позволяет выполнять битовые и логические операции над операндами, содержащимися в памяти и различных секторах. АЛУ способно выполнять арифметические или булевы операции, над комплексными числами используя два регистра аккумулятора или работать как два АЛУ, выполняя две операции одновременно. Блок барабанного сдвига и блок адресной арифметики позволяют ускорить выполнение типовых операций сигнальной обработки. Блок барабанного сдвига осуществляет сдвиг данных на 0 -31 разряд влево или 0 -16 разрядов вправо за один такт, а также вычисления экспоненциальной функции. Он позволяет выполнять нормализацию содержимого аккумулятора за один такт. Эти функции сдвига позволяют процессору осуществлять масштабирование данных, выделять разряды числа, предотвращать возникновения переполнения и потери значимости. Блок умножения с накоплением (МАС) повышает гибкость и производительность МК за счет выполнения над 17битными операндами операции S=S+a x b за один процессорный такт. Эта операция применяется для алгоритмов фильтрации свертки, вычисления корреляционной функции. Вместе с АЛУ может осуществлять операции в одном цикле одновременно. Блок перекодировки позволяет перекодировать значения аккумулятора (интерпретировать его как значение аргумента функции.) за один такт Он позволяет быстро вычислять функцию y=exp(x) за один такт Блок CMPS обеспечивает реализацию оператора Витерби и выполняет операцию сравнения с накоплением. Переключатель банков памяти позволяет автоматически добавлять один такт при пересечении границ банка памяти внутри программного адресного пространства или при переходе от пространства адресов команд к пространству адресов данных. Этот дополнительный такт позволяет устройству памяти освободить шину раньше, чем другое устройство получит доступ к ней, избегая тем самым конфликтной ситуации при обращении к памяти. Встроенный контроллер ПДП позволяет совмещать во времени выполнение обменов данными с памятью и вычисления Умножитель данных в форматах с плавающей точкой и целочисленном позволяет производить умножение за один такт независимо от типа данных и параллельно с обработкой данных в других функциональных блоках (например, АЛУ) Модуль регистровой арифметики (используются парами) позволяет работать параллельно с АЛУ и генерирует два адреса в одном такте Регистр повышенной точности служат для размещения результатов операций с плавающей точкой. Они предназначены для хранения и обработки целых чисел и 40 разрядных чисел с плавающей точкой Дополнительные регистры предназначены для косвенных способов адресации. Их основная задача генерация 32 разрядных адресов Они могут применятся как счетчики циклов и как регистры общего назначения.
Первичный регистровый файл содержит регистры общего назначения, которые используют АЛУ и умножители совместно. Двухвходовый блок ROM содержит программу начальной загрузки КЭШ команд процессора содержит часто используемые участки кода, что позволяет сократить среднее время выборки команд. Кэш работает избирательно - кэшируются только те команды выборка которых конфликтует с выборкой данных из памяти программ (РМ) Контроллер обмена управляет операциями обмена процессоров и памяти как внутри кристалла через коммутатор, так и вне кристалла с использованием входящих в его состав интерфейсных схем поддерживающих распространенные стандарты памяти и обеспечивающих возможность динамического изменения разрядности шины от 8 до 64. Использование приоритетной дисциплины запросов памяти на обслуживание в режиме DMA контроллер обмена позволяет выполнять обмен данными не прерывая вычислений со скоростью 400Мбайт/с. Он поддерживает линейную и координатную адресацию памяти для эффективного выполнения обмена при работе с 2 и 3 мерными графическими изображениями. Видеоконтроллер позволяет захватывать и отображать видеоинформацию в режимах как вертикального, так и горизонтального сканирования. Режимы захвата/ сканирования могут устанавливаться для каждого из контроллеров независимо. М- модуль предназначен для умножения 24 и 32 разрядных целочисленных данных и 32 и 64 разрядных данных в формате с плавающей точкой L -модуль предназначен для выполнения арифметических операций над 32 и 40 разрядными целочисленными данными и 32 и 64 разрядных данных в формате с плавающей точкой S-модуль предназначен для выполнения операций сдвига , перехода и отдельных операций с 32 и 64 разрядных данных в формате с плавающей точкой D - модуль предназначен для выполнения адресных операций.
Регистр режима адресации определяет способ адресации. Устройство выборки декодирования диспетчеризации команд позволяет направлять до восьми 32 разрядных команд по каждому из путей обработки данных Буфер каждый буфер состоит из внешнего и внутреннего регистров. При передаче внутренний регистр используется для приема данных из внутренней памяти под управлением контроллера или процессора. Внешний регистр используется для распаковки полубайтов для порта канала (линка). Старший полубайт следует первым. Эти два регистра формируют FIFO очередь. Два слова могут быть помещены в буфер прежде чем выработается сигнал заполнено. Если регистр пуст уровень сигнала низкий. При приеме внешний регистр упаковывает принимаемые полубайты в слова и передает их через внутренний регистр в память под управлением контроллера или процессора. Если они не успели извлечь данные из внутреннего регистра и оба регистра буфера заняты сигнал не выдается и прием прекращается.
Управляющий регистр хранит информацию о состоянии счетчика полубайтов каждого порта линка. Если по завершении передачи счетчик не обнулен то вырабатывается сигнал об ошибке при передаче . Для контроля этого сигнала применяются специальные протоколы на передающем и принимающем концах линка. В конце передачи блока сло передающий МП должен настроить свой порт на прием. Протокол обмена предусматривает передачу одного дополнительного пустого слова. Это позволяет принимающему МП переслать сообщение передающему. Протокол приема предусматривает после получения блока данных выработку прерывания, реализующего чтение управляющего регистра и передачу соответствующего сообщения передающему МП.
Аналогово-цифровой компаратор Аналогово-цифровой преобразователь
Функция энергосбережения В МП используются: Активный режим Периферийные режимы. В нем центральный процессор останавливается и работают только периферийные устройства. Режим сна. В нем процессор останавливается до получения сигнала прерывания
Рис Структурная схема МК
ОРГАНИЗАЦИЯ ПАМЯТИ МИКРОКОНТРОЛЛЕРА ATMEGA8535 Архитектура микропроцессора включает 3 типа памяти: память программ FLASH; оперативная память (ОЗУ) SRAM; энергонезависимая память данных EEPROM. В микроконтроллерах AVR семейства Mega разделены не только адресные пространства памяти программ и памяти данных, но также и шины доступа к ним. Способы адресации и доступа к этим областям памяти также различны. Такая структура позволяет центральному процессору работать одновременно как с памятью программ, так и с памятью данных, что существенно увеличивает производительность. Каждая из областей памяти данных (ОЗУ и EEPROM) также расположена в своем адресном пространстве. Память программ размером 8 кбайт представляет собой электрически стираемое ППЗУ (FLASH) и организована в виде 4 кбайт × 16 бит с целью поддержки 16-битных команд . Для возможности защиты кода память программ разделена на 2 секции: секция загрузчика (Boot Program) и секция прикладных программ (Application Program). Поскольку микроконтроллеры AVR имеют 16-битную систему команд, объем памяти программ указан не в байтах, а в 16-битных словах. Память программ является электрически перепрограммируемой, количество циклов перезаписи превышает 10 тысяч. Микропроцессор поддерживает также внутрисхемное программирование, т. е. прошивку программы в микропроцессор можно осуществлять после монтажа на плату посредством специального разъема программирования. Для адресации памяти программ используется счетчик команд (Program Counter – PC). Счетчик команд (PC) является 12-битным и адресует все адресное пространство памяти команд. По адресу 0x0000 памяти программ находится вектор сброса. После инициализации (сброса) микроконтроллера выполнение программы начинается с этого адреса (по этому адресу должна размещаться команда перехода к инициализационной части программы). Начиная с адреса 0x0001 памяти программ, располагается таблица векторов прерываний. При возникновении прерывания после сохранения в стеке текущего значения счетчика команд происходит выполнение команды, расположенной по адресу соответствующего вектора. Поэтому по данным адресам располагаются команды перехода к подпрограммам обработки прерываний. Положение вектора сброса и таблицы векторов прерываний может быть изменено. Они могут располагаться не только в начале памяти программ, как описано выше, но и в начале области загрузчика. Если в программе прерывания не используются, либо таблица векторов прерываний располагается в области загрузчика, то основная программа может начинаться непосредственно с адреса 0x0001. Память программ может использоваться не только для хранения кода программы, но и для хранения различных констант. Для пересылки байта из памяти программ в память данных существует специальная команда – LPM. Оперативная память Оперативная память состоит из 608 ячеек, разделенных на 3 области: 32 регистра общего назначения; 64 служебных регистра; 512 байт памяти для хранения данных. Микропроцессор поддерживает 5 способов адресации операндов команд: прямая адресация; косвенная адресация; косвенная адресация со смещением; косвенная адресация с предварительным уменьшением адреса; косвенная адресация с последующим увеличением адреса.
Регистры общего назначения Все регистры общего назначения (РОН) объединены в регистровый файл быстрого доступа, структура которого показана на рис. 9. В микроконтроллерах AVR все 32 РОН непосредственно доступны АЛУ, в отличие от 8-битных микроконтроллеров других фирм, в которых имеется только один такой регистр – рабочий регистр W (аккумулятор). Благодаря этому любой РОН может использоваться практически во всех командах и как операнд-источник, и как операнд-приемник. Такое решение (в сочетании с конвейерной обработкой) позволяет АЛУ выполнять одну операцию (извлечение операндов из регистрового файла, выполнение команды и запись результата обратно в регистровый файл) за один такт. Каждый регистр файла имеет свой собственный адрес в пространстве памяти данных. Поэтому к ним можно обращаться двумя способами – как к регистрам и как к памяти, несмотря на то, что физически эти регистры не являются ячейками ОЗУ. Такое решение является еще одной отличительной особенностью архитектуры AVR, повышающей эффективность работы микроконтроллера и его производительность. Последние 6 регистров файла (R26...R31) могут также объединяться в три 16- битных регистра X, Y и Z (см. рис. 9), используемых в качестве указателей при косвенной адресации памяти данных. Служебные регистры Каждый служебный регистр имеет свое имя, адрес и назначение. Адресное пространство служебных регистров поддерживает обращение с помощью команд IN (считать данные из регистра) и OUT (записать данные в регистр). Обращение к отдельным битам служебных регистров возможно посредством команд SBI (установить бит), CBI (сбросить бит). Проверка содержимого битов служебных регистров возможна с помощью команд SBIS и SBIC. К регистрам ввода-вывода можно обращаться и как к ячейкам ОЗУ с помощью соответствующих команд ST/SD/SDD и LD/LDS/LDD (для дополнительных РВВ этот способ является единственно возможным). Среди служебных регистров есть один регистр, используемый наиболее часто в процессе выполнения программ. Это регистр состояния SREG. Он располагается по адресу 0x3F (0x5F) и содержит набор флагов, показывающих текущее состояние микроконтроллера. Большинство флагов автоматически устанавливаются в «1» или сбрасываются в «0» при наступлении определенных событий (в соответствии с результатом выполнения команд). Все биты этого регистра доступны как для чтения, так и для записи; после сброса микроконтроллера все биты регистра сбрасываются в 0. Эта информация анализируется при выполнении условных переходов. При возникновении прерываний содержимое регистра SREG необходимо сохранять программно. Формат этого регистра показан на рис. 10. Рис. 10. Регистр состояния SREG I – бит прерывания; разрешает прерывания, если установлен в «1»; значение «0» запрещает прерывания; T – источник сохранения/копирования бита; команды копирования бита (BLD – загрузка бита; BST – сохранение бита) используют данный бит в качестве источника; H – десятичный перенос; устанавливается в «1» при генерации переноса из младшей тетрады битов (4бита) в старшую, используется при работе с двоично-десятичными числами; S – знаковый бит; определяется как исключающее или битов XOR(V,N); V – бит переполнения; устанавливается в «1» при выходе за разрядную сетку результата последней команды; N – бит отрицательного значения; устанавливается в «1» при отрицательном результате выполнения последней команды; Z – бит нулевого значения; устанавливается в «1» при нулевом результате выполнения последней команды; C – бит переноса; устанавливается в «1» при генерации переноса последней исполняемой командой. Память данных Память данных представляет собой 512 8-битных ячеек, расположенных по адреса
Популярное: Организация как механизм и форма жизни коллектива: Организация не сможет достичь поставленных целей без соответствующей внутренней... Как построить свою речь (словесное оформление):
При подготовке публичного выступления перед оратором возникает вопрос, как лучше словесно оформить свою... ©2015-2024 megaobuchalka.ru Все материалы представленные на сайте исключительно с целью ознакомления читателями и не преследуют коммерческих целей или нарушение авторских прав. (1886)
|
Почему 1285321 студент выбрали МегаОбучалку... Система поиска информации Мобильная версия сайта Удобная навигация Нет шокирующей рекламы |